(转)如何评价微软在其数据中心大量部署FPGA?

,FPGA 中的寄存器和片上内存(BRAM)是属于各自的控制逻辑的,无需不必要的仲裁和缓存。对于通信的需求,FPGA 每个逻辑单元与周围逻辑单元的连接在重编程(烧写)时就已经确定,并不需要通过共享内存来通信。 说了这么多三千英尺高度的话,FPGA 实际的表现如何呢?我们分别来看计算密集型任务和通信密集型任务。 计算密集型任务的例子包括矩阵运算、图像处理、机器学习、压缩、非对称加密、Bing 搜索的排序...

http://home.eeworld.com.cn/my/space-uid-346593-blogid-460025.html 发布时间: 2017-02-06



【小梅哥FPGA进阶教程】第七章 VGA控制器设计与验证

多路器即可实现: 添加PLL时钟分频单元      通过以上步骤,我们就完成了简易VGA控制器测试电路的主要电路设计。在前面我们曾经提到,VGA控制器的像素时钟为25MHz,而我们芯航线FPGA开发板设计的是50MHz的晶振,因此需要使用锁相环对时钟进行分频得到25MHz的时钟,以供VGA控制器使用。注意,虽然我们直接使用寄存器二分频也能从50M直接...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-460004.html 发布时间: 2017-02-06



【小梅哥FPGA进阶教程】第六章 PS2键盘驱动设计与验证

的Cnt1的数据是已经更新了的,我们需要在Cnt1已经变化之后再来使用其值做判断,即在PS2时钟下降沿检测成功后,滞后一个系统时钟周期后再来读取PS2_Din上的值,比较简单的操作方式就是将PS2时钟下降沿检测标志信号再用寄存器打一拍,对应代码如下: 可能这里相对比较难以理解,希望大家结合仿真结果自学揣摩体会。接下来就是根据Cnt1的计数值来读取每一位的数据了,这部分代码很简单,如下所示...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-459997.html 发布时间: 2017-02-04



一文了解FPGA发展之路 —— 将功耗和价格降低一万倍

驱动, 而且人们很容易认为 FPGA 的发展只是随着工艺的发展简单地增大了容量。其实并没有这么简单。真正的故事要精彩得多。1、发明时代(1984 年 - 1992 年) 首款 FPGA,即赛灵思 XC2064,只包含 64 个逻辑模块,每个模块含有两个 3 输入查找表 (LUT) 和一个寄存器。按照现在的计算,该器件有 64 个逻辑单元——不足 1000 个逻辑门。尽管容量很小,XC2064 晶片...

http://home.eeworld.com.cn/my/space-uid-346593-blogid-459173.html 发布时间: 2017-01-22



【小梅哥FPGA进阶教程】第五章 无源蜂鸣器驱动设计

设计定时/计数器的计数时钟源频率为芯航线FPGA学习套件主板上晶体振荡器的输出频率50MHz,定时/计数器位宽为32位,则计数器代码如下所示: 输出比较电路       输出比较电路通过比较计数器实时计数值与比较寄存器中的设定值,来确定最终PWM输出信号的电平状态。这里,我们可以定义,当计数器计数值大于等于比较值时,PWM输出端输出低电平,当计数值小于...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-459020.html 发布时间: 2017-01-14



FPGA IO口时序约束是怎么一回事?

原文地址 一、参数定义: (1) Tdin为从FPGA的IO口到FPGA内部寄存器输入端的延时; (2) Tclk为从FPGA的IO口到FPGA内部寄存器时钟端的延时; (3) Tus/Th为FPGA内部寄存器的建立时间和保持时间; (4) Tco为FPGA内部寄存器传输时间; (5) Tout为从FPGA寄存器输出到IO口输出的延时; (6...

http://home.eeworld.com.cn/my/space-uid-346593-blogid-459017.html 发布时间: 2017-01-14



2017年一定要关注ARM这三大技术(转)

多家编译器厂商实现并支持,代码非常便捷易用。比如说,在创建可以从非安全状态调度的安全API时,应该使用一个名为“cmse_nonsecure_entry”的全新功能属性来做函数声明。安全状态调度功能使用结束时,处理器中的寄存器仍可能保留一些秘密信息。凭借正确的功能属性,编译器便可自动插入代码,清空R0-R3、R12和应用程序状态寄存器(APSR)中仍保留秘密信息的寄存器,但是寄存器将结果返还给非...

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【小梅哥FPGA进阶教程】第三章 TLC5620型DAC驱动设计

3个部分,包括8位的数据位,2位的DAC选择位,1位的电压倍增控制位。每个DAC的寄存器都采用双缓冲结构,这样,可以实现首先通过数据总线给所有的DAC传输需要更新的数据,然后通过控制信号LDAC将所有DAC的电压同步更新到输出上。TLC5620芯片内部框图TLC5620型DAC芯片引脚说明: TLC5620型DAC芯片详细介绍:TLC5620是由四个电阻串式DAC组成的,每个DAC的核心是一个...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458982.html 发布时间: 2017-01-11



【小梅哥FPGA进阶教程】第二章 二进制转BCD

键盘输入的数据需要在数码管上显示的时候,矩阵键盘输入的数字是二进制数,而数码管上需要显示的是十进制数,所以需要将二进制数转换成BCD码,这在我们以后的设计中会经常遇到。转换原理对于一个8位二进制码,其在十进制编码方式下的值为:把上式写出套乘的形式:式中的每项乘2,相当于将寄存器中的二进制码左移1位,这就意味着利用移位寄存器可以完成二进制与8421BCD的转换。在移位的过程中,当现态<5时,次态...

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【小梅哥FPGA进阶教程】第一章 FPGA矩阵键盘驱动设计与验证

下一个状态READ_ROW_P获取行状态的值,否则不跳转;       3、READ_ROW_P状态:读取行状态并将存入的寄存器中Key_Board_Row_r(ps:存入寄存器是因为按键按下的时间比较短暂,所以要将其状态缓存起来),并将第0列拉低,进入SCAN_C0状态进行行扫描;       4、SCAN_C0状态...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458931.html 发布时间: 2017-01-07



【FPGA开源教程连载】第十九章 HT6221红外遥控器

遥控器。这里的范围可以针对特定的红外遥控器再行修改,一般采取以下范围即可。        同样由于这里红外接收头输入到FPGA内部的信号也是异步信号,也需要进行数据同步,同步后的数据再用两级寄存器来判断上升沿还是下降沿。具体设计及数据同步、边沿检测原理可参考按键设计一讲。4.红外解码状态机分析现在对状态进行编码首先由以上的分析可以看出状态分为:S0...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458920.html 发布时间: 2017-01-06



【FPGA开源教程连载】第十八章 线性序列机与TLV5144驱动设计

[9:0]为采样结果数据寄存器。表18-3时间点对应信号操作表线性序列机计数器的控制逻辑判断依据,如表18-4所示。表18-4计数器功能判断条件实验步骤:       同样得到了表18-3与18-4即可开始进行TLV1544的接口逻辑的编写。TLC1520接口逻辑的模块图如图18-5所示:图18-5TLV1544模块接口示意图其中,每个端口的功能描述如表...

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【FPGA开源教程连载】第十七章 线性序列机与串行接口DAC驱动设计

倍增控制位。每个DAC的寄存器都采用双缓冲结构,这样,可以实现首先通过数据总线给所有的DAC传输需要更新的数据,然后通过控制信号LDAC将所有DAC的电压同步更新到输出上。图17-1TLC5620芯片内部框图2. DAC芯片引脚说明       TLC5620芯片引脚及功能描述如表17-1所示。 表17-1芯片引脚功能描述3.TLC5620型DAC芯片详细...

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【FPGA开源教程连载】第十三章B 搭建串口收发与存储双口RAM简易应用系统

;  在上一讲中仿真双端口RAM时发现其输出延迟两个系统时钟周期。这样为了保证数据变化稳定之后才进行数据输出,将驱动Send_en的信号接两级寄存器进行延迟两拍。当按键按下后启动一次发送,然后判断上一字节是否发送结束,是则进行下一字节发送否则不进行下一次发送。          编译无误后,可以在RTL viewer中查到如图13-2所示...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458871.html 发布时间: 2017-01-04



【sensorTile】使用Mbed进行程序开发的问题及解决

模板建立的程序,导出后是完整的,可以在Keil中仿真,这次发现PORTG相关的寄存器被被设置,所以LED不亮。 进一步仿真就需要查看程序源码了,而STM32L476_DISCO模块提供了很多文件是obj格式的,带来不便。先是在online IDE中将mbed库删除,导入mbed-dev,结果这样就无法导出程序了,这好像是online IDE有限制。最后回到开始的STM32L476_DISCO...

http://home.eeworld.com.cn/my/space-uid-573537-blogid-458852.html 发布时间: 2017-01-02



【FPGA开源教程连载】第十三章A 嵌入式RAM使用之双端口RAM

。       图13-1Cyclone IV体系结构逻辑单元 (LE) 在 Cyclone IV 器件结构中是最小的逻辑单位。LE 紧密且有效的提供了高级功能的逻辑使用。其内部结构如图13-2所示。可以LE基本包含以下几个部分:4输入查找表LUT、D触发器(可以对每个LE 配置可编程的寄存器为D、T、JK或SR触发器操作)以及其它组合逻辑。详细介绍可参考...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458848.html 发布时间: 2017-01-02



【FPGA开源教程连载】第十一章 串口发送模块设计与验证

以上原理,串口发送模块整体框图如图11-5所示,其接口列表如表11-2所示。图11-5 串口发送模块整体框图表11-3 模块接口列表经过以上的分析,串口发送模块详细结构图如图11-6所示,其中每一子模块的作用如表11-4所示。其中绿色的框代表单一结构的寄存器,来实现数据的稳定输入以及输出。 图11-6 串口发送模块结构图表11-4 子功能块功能描述建立工程子文件夹后,新建一个以名为...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458820.html 发布时间: 2016-12-29



【FPGA开源教程连载】第十章 8位7段数码管驱动实验

8位7段数码管驱动实验https://imgcache.qq.com/tencentvideo_v1/playerv3/TPout.swf?max_age=86400&v=20161117&vid=k0188lc5bf8&auto=0 实验目的: 1.实现FPGA驱动数码管动态显示;                 2.使用In system sources and probes editor工具,输入需要显示在数码管上的的数据,数码管显示对应数...

http://home.eeworld.com.cn/my/space-uid-739808-blogid-458814.html 发布时间: 2016-12-29



【FPGA开源教程连载】第八章 独立按键消抖实验A

;    由实验原理中的状态转移表可以看出其转换条件中需要检测到下降沿以及上升沿,而边沿检测其原理就是利用两级寄存器寄存的不同值来进行比较判断,如图9-8所示。图9-8边沿检测原理图其检测过程,可以假设data_in从0变1,也就是上升沿:第一个时钟到来第一个寄存器regc的输出为0;第二个时钟沿到来后第一个寄存器输出为1,第二个寄存器输出此时为0,这样对两个寄存器输出进行...

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【FPGA开源教程连载】第七章 状态机设计实例

状态机图8-2 米利型状态机状态机顾名思义会有各种状态,这也就分支出一种情况如何对状态进行有效的编码。编码格式,最简单的就是直接使用二进制进行表示,除此之外还有使用格雷码、独热码。假设有八个状态从A到R,利用不同的编码格式分别如表8-1所示。表8-1 状态不同的编码格式独热码,每一个状态均使用一个寄存器,相比其他译码简单;格雷码,所需寄存器数与二进制码一样,译码复杂,但相邻位只跳动一位,一般用于异步...

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