【小梅哥FPGA进阶教程】第十一章 四通道幅频相可调DDS信号发生器 下

为8个字节,整体数据由帧头+地址+数据+帧尾的格式组成。这样就可以实现对固定的寄存器地址写入不同的数据。 表5 自定义帧数据格式不同的寄存器地址对应不同通道的不同的被控制数。系统设计了12个实体寄存器分别存储每个通道的相关控制参数。12个寄存器分为4组,分别对应了4个通道。每组包含3个寄存器,频率控制字寄存器,相位控制字寄存器以及幅度控制字寄存器。具体的各实体控制寄存器地址与对应功能如表6所示...

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【小梅哥FPGA进阶教程】第十一章 四通道幅频相可调DDS信号发生器 上

数控调制,广泛应用于通信领域。 DDS 的基本结构图如图1所示。 图1 DDS基本结构图由图1可以看出,DDS主要由相位累加器、相位调制器、波形数据表以及 D/A 转换器构成。 其中相位累加器由 N位加法器与N位寄存器构成。每来一个时钟,加法器就将频率控制字与累加寄存器输出的相位数据相加,相加的结果又反馈至累加寄存器的数据输入端,以使加法器在下一个时钟脉冲的作用下继续与频率控制字相加。这样...

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当STM32遇到SDRAM

2. RCC中使能FMC控制器 3. 配置SDRAM Bank的参数寄存器,包括Timing 4. 执行 InitSequence 给控制器发命令。   在ST手册上也描述了怎么配置FMC SDRAM部分的寄存器,其实说穿了也简单,主要是SDCR(1或者2), 和SDTR(1或者2). 然后用SDCMR来执行几次命令,等待SDSR寄存器的完成状态。最后在SDRTR中设置SDRAM刷新...

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【小梅哥FPGA进阶教程】MC8051软核在FPGA上的使用 上

; ● 指令执行时间为 1~4 个时钟周期,执行性能优于标准 8051 微控制器 8 倍左右      ● 用户可选择定时器/计数器、串行接口单元的数量      ● 新增了特殊功能寄存器用于选择不同的定时器/计数器、串行接口单元      ● 可选择是否使用...

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ARM处理器异常返回地址

在ARM处理器中一条指令的执行分为取指、译码、执行三个阶段,由于指令流水线的存在造成当前执行的指令的地址是PC-8(ARM指令集),那么当前执行指令的下一条指令的地址应该是PC-4,所以在异常产生时处理器会将PC-4的值保存到对应模式的LR寄存器中,但是该返回地址是否能够被使用还要看具体产生的异常的种类而定。FIQ与RIQ异常:FIQ与RIQ异常返回处理是一样的,当处理器执行完当前指令后才去查询...

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main()之前都干了什么

main()是用户程序的入口,那么MCU在main()之前都做了什么呢,下面以stm32f10x芯片为例,描述下main()之前的事情。简单说MCU在进入main()之前,一直在做进入main()的准备工作。那么这些准备工作都包括什么?一、初始化MSP与PC寄存器stm32离开复位状态之后自动从以下两个地址取值:从0x00000000地址读取MSP的初始值,即栈指针从0x00000004地址读取...

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【小梅哥FPGA进阶教程】第九章 基于串口猎人软件的串口示波器 下

相位累加器,相位调制器,正弦数据表,和D/A转换器构成,相位累加器由N位加法器与N位寄存器构成。每来一个时钟,加法器就将频率控制字,与累加寄存器输出的相位数据相加,相加的结果又反馈至累加寄存器的数据输入端,以使加法器在下一个时钟脉冲的作用下继续与频率控制字相加,这样,相位累加器在时钟作用下,不断对频率控制字进行线性相位累加。由此可以看出,在每一个时钟脉冲输入时,相位累加器便把频率控制字累加一次...

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【小梅哥FPGA进阶教程】第九章 基于串口猎人软件的串口示波器 上

ADC采集到的信号细节。同时,用户也可以使用串口猎人通过串口给下位机(FPGA)发送指令,下位机将对接收到的指令进行解码,然后依据解码结果来配置FPGA中各个子模块的控制寄存器,以实现通过串口控制FPGA中子模块工作状态的功能。 本实验中,涉及到的应用模块和知识点如下所示: 串口收发模块的设计和使用;串口收发模块仿真模型的设计;串口简单数据帧的解码;串口帧转Memory Mapped总线的设计...

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关于f407和f103can通信不上的问题?

;CAN_InitStructure;                  /************************CAN通信参数设置**********************************/         /*CAN寄存器初始化...

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在SensorTile上使用MicroPython(二)

此内容由EEWORLD论坛网友dcexpert原创,如需转载或用于商业用途需征得作者同意并注明出处 LPS22HB 的 Micropython 程序移植 前面介绍了传感器的接口、主要寄存器、参数计算等方面的内容,下面就介绍用MicroPython驱动LPS22HB的方法。 为了让程序具有通用性,以及系统模块化的要求,我们将为 LPS22HB 单独建立一个 Module,这样也...

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在SensorTile上使用MicroPython(一)

', Pin.OPEN_DRAIN, pull=Pin.PULL_UP) scl=machine.Pin('PB13', Pin.OPEN_DRAIN, pull=Pin.PULL_UP)复制代码 传感器寄存器 ST公司为SensorTile kit提供了多个例程,例程中包含了传感器的底层驱动函数。如果使用C++编程,可以使用这些驱动函数。而我们要使用micropython进行编程,所以无法直接使用ST的...

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至芯科技FPGA就业培训班 2.0新课程体系

/DDR3课程 SDRAM的发展历史,L-Bank结构,SDRAM控制器的本地逻辑接口,SDRAM的工作原理,使用FPGA控制SDRAM的算法机模型(控制和数据通道的分离),以及SDRAM的逻辑控制:预充电,刷新,命令,突发,寄存器设置,上电初始化,读/写序列等。 采用美光的器件模型,构成完整的访问控制模块的编码和验证。该课程的目标是:通过学习,学员将能够独立的编写SDRAM和DDR2/DDR3控制器...

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(转)如何评价微软在其数据中心大量部署FPGA?

,FPGA 中的寄存器和片上内存(BRAM)是属于各自的控制逻辑的,无需不必要的仲裁和缓存。对于通信的需求,FPGA 每个逻辑单元与周围逻辑单元的连接在重编程(烧写)时就已经确定,并不需要通过共享内存来通信。 说了这么多三千英尺高度的话,FPGA 实际的表现如何呢?我们分别来看计算密集型任务和通信密集型任务。 计算密集型任务的例子包括矩阵运算、图像处理、机器学习、压缩、非对称加密、Bing 搜索的排序...

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【小梅哥FPGA进阶教程】第七章 VGA控制器设计与验证

多路器即可实现: 添加PLL时钟分频单元      通过以上步骤,我们就完成了简易VGA控制器测试电路的主要电路设计。在前面我们曾经提到,VGA控制器的像素时钟为25MHz,而我们芯航线FPGA开发板设计的是50MHz的晶振,因此需要使用锁相环对时钟进行分频得到25MHz的时钟,以供VGA控制器使用。注意,虽然我们直接使用寄存器二分频也能从50M直接...

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【小梅哥FPGA进阶教程】第六章 PS2键盘驱动设计与验证

的Cnt1的数据是已经更新了的,我们需要在Cnt1已经变化之后再来使用其值做判断,即在PS2时钟下降沿检测成功后,滞后一个系统时钟周期后再来读取PS2_Din上的值,比较简单的操作方式就是将PS2时钟下降沿检测标志信号再用寄存器打一拍,对应代码如下: 可能这里相对比较难以理解,希望大家结合仿真结果自学揣摩体会。接下来就是根据Cnt1的计数值来读取每一位的数据了,这部分代码很简单,如下所示...

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一文了解FPGA发展之路 —— 将功耗和价格降低一万倍

驱动, 而且人们很容易认为 FPGA 的发展只是随着工艺的发展简单地增大了容量。其实并没有这么简单。真正的故事要精彩得多。1、发明时代(1984 年 - 1992 年) 首款 FPGA,即赛灵思 XC2064,只包含 64 个逻辑模块,每个模块含有两个 3 输入查找表 (LUT) 和一个寄存器。按照现在的计算,该器件有 64 个逻辑单元——不足 1000 个逻辑门。尽管容量很小,XC2064 晶片...

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【小梅哥FPGA进阶教程】第五章 无源蜂鸣器驱动设计

设计定时/计数器的计数时钟源频率为芯航线FPGA学习套件主板上晶体振荡器的输出频率50MHz,定时/计数器位宽为32位,则计数器代码如下所示: 输出比较电路       输出比较电路通过比较计数器实时计数值与比较寄存器中的设定值,来确定最终PWM输出信号的电平状态。这里,我们可以定义,当计数器计数值大于等于比较值时,PWM输出端输出低电平,当计数值小于...

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FPGA IO口时序约束是怎么一回事?

原文地址 一、参数定义: (1) Tdin为从FPGA的IO口到FPGA内部寄存器输入端的延时; (2) Tclk为从FPGA的IO口到FPGA内部寄存器时钟端的延时; (3) Tus/Th为FPGA内部寄存器的建立时间和保持时间; (4) Tco为FPGA内部寄存器传输时间; (5) Tout为从FPGA寄存器输出到IO口输出的延时; (6...

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2017年一定要关注ARM这三大技术(转)

多家编译器厂商实现并支持,代码非常便捷易用。比如说,在创建可以从非安全状态调度的安全API时,应该使用一个名为“cmse_nonsecure_entry”的全新功能属性来做函数声明。安全状态调度功能使用结束时,处理器中的寄存器仍可能保留一些秘密信息。凭借正确的功能属性,编译器便可自动插入代码,清空R0-R3、R12和应用程序状态寄存器(APSR)中仍保留秘密信息的寄存器,但是寄存器将结果返还给非...

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【小梅哥FPGA进阶教程】第三章 TLC5620型DAC驱动设计

3个部分,包括8位的数据位,2位的DAC选择位,1位的电压倍增控制位。每个DAC的寄存器都采用双缓冲结构,这样,可以实现首先通过数据总线给所有的DAC传输需要更新的数据,然后通过控制信号LDAC将所有DAC的电压同步更新到输出上。TLC5620芯片内部框图TLC5620型DAC芯片引脚说明: TLC5620型DAC芯片详细介绍:TLC5620是由四个电阻串式DAC组成的,每个DAC的核心是一个...

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